“(手册)SpyGlass® CDC Customer Training Release 5.1.0” 的相关文章
SOC 在线修改设备树和FPGA配置文件 并在线配置FPGA
测试过的平台: 1、DE-10 Cyclone V开发板  ...
Verilog实现时钟分频(奇数分频,偶数分频)二分频 三分频 四分频 五分频
完整工程文件:clkdiv.zip//------------------------------------------------------// File Name : clkdiv.v// Author &nb...
Verilog实现串并转换
项目文件:SIPO.zip//------------------------------------------------------// File Name : SIPO.v// Author &n...
点亮LED灯实验
设计流程:设计规划 -> 波形绘制 -> 代码编写 -> 代码编译 -> 逻辑仿真 -> 波形对比 -> 绑定管脚 -> 分析综合布局布线 -> 上板验证新建项目文件夹(led):Doc:放置文档资料(数据手册、波形图、文档、项目日志)Pri:放置工程...
全加器(层次化设计)
该篇博客根据上一篇半加器的设计,再结合层次化的设计思想来实现一个全加器!层次化设计理论部分:数字电路中根据模块层次的不同有两种基本的结构设计方法:自底向上的设计方法 和 自顶向下的设计方法自底向上(Bottom-Up) 自底向上的设计是一种传统的设计方法,对设计进行逐次划分的过程是从存...
单比特和多比特的信号处理
信号跨时钟域传输时,两个时钟的上升沿相位差没有固定关系,所以采样时钟很容易出现建立保持时间违例而采到亚稳态。使用两级同步器处理:两级同步器能降低亚稳态发生的概率,只是使信号变为稳态再往下传输,保证安全但并不保证正确。如上图,A信号建立保持时间,导致B为亚稳态,但是由于有F3的存在,使其有足够的时间恢...




